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diff --git a/fpga_interchange/arch.cc b/fpga_interchange/arch.cc
index e8a8cdc1..faf3c9d1 100644
--- a/fpga_interchange/arch.cc
+++ b/fpga_interchange/arch.cc
@@ -45,14 +45,7 @@ static std::pair<std::string, std::string> split_identifier_name_dot(const std::
 
 // -----------------------------------------------------------------------
 
-void IdString::initialize_arch(const BaseCtx *ctx)
-{
-#define X(t) initialize_add(ctx, #t, ID_##t);
-
-#include "constids.inc"
-
-#undef X
-}
+void IdString::initialize_arch(const BaseCtx *ctx) {}
 
 // -----------------------------------------------------------------------
 
@@ -70,6 +63,13 @@ Arch::Arch(ArchArgs args) : args(args)
         log_error("Unable to read chipdb %s\n", args.chipdb.c_str());
     }
 
+    // Read strings from constids into IdString database, checking that list
+    // is unique and matches expected constid value.
+    int id = 1;
+    for (const auto &constid : *chip_info->constids) {
+        IdString::initialize_add(this, constid.get(), id++);
+    }
+
     tileStatus.resize(chip_info->tiles.size());
     for (int i = 0; i < chip_info->tiles.size(); i++) {
         tileStatus[i].boundcells.resize(chip_info->tile_types[chip_info->tiles[i].type].bel_data.size());
diff --git a/fpga_interchange/arch.h b/fpga_interchange/arch.h
index aec1b0b2..52dbf8ab 100644
--- a/fpga_interchange/arch.h
+++ b/fpga_interchange/arch.h
@@ -152,9 +152,7 @@ NPNR_PACKED_STRUCT(struct TileWireRefPOD {
     int32_t index;
 });
 
-NPNR_PACKED_STRUCT(struct NodeInfoPOD {
-    RelSlice<TileWireRefPOD> tile_wires;
-});
+NPNR_PACKED_STRUCT(struct NodeInfoPOD { RelSlice<TileWireRefPOD> tile_wires; });
 
 NPNR_PACKED_STRUCT(struct CellMapPOD {
     // Cell names supported in this arch.
@@ -178,6 +176,8 @@ NPNR_PACKED_STRUCT(struct ChipInfoPOD {
     RelSlice<int32_t> bel_buckets;
 
     RelPtr<CellMapPOD> cell_map;
+
+    RelPtr<RelSlice<RelPtr<char>>> constids;
 });
 
 /************************ End of chipdb section. ************************/
@@ -192,7 +192,8 @@ template <typename Id> const TileTypeInfoPOD &loc_info(const ChipInfoPOD *chip_i
     return chip_info->tile_types[chip_info->tiles[id.tile].type];
 }
 
-inline const BelInfoPOD &bel_info(const ChipInfoPOD *chip_info, BelId bel) {
+inline const BelInfoPOD &bel_info(const ChipInfoPOD *chip_info, BelId bel)
+{
     NPNR_ASSERT(bel != BelId());
     return loc_info(chip_info, bel).bel_data[bel.index];
 }
@@ -850,8 +851,8 @@ struct Arch : BaseCtx
     {
         NPNR_ASSERT(wire != WireId());
         if (wire.tile != -1) {
-            const auto & tile_type = loc_info(chip_info, wire);
-            if(tile_type.wire_data[wire.index].site != -1) {
+            const auto &tile_type = loc_info(chip_info, wire);
+            if (tile_type.wire_data[wire.index].site != -1) {
                 int site_index = tile_type.wire_data[wire.index].site;
                 const SiteInstInfoPOD &site = chip_info->sites[chip_info->tiles[wire.tile].sites[site_index]];
                 std::array<IdString, 2> ids{id(site.name.get()), IdString(tile_type.wire_data[wire.index].name)};
diff --git a/fpga_interchange/archdefs.h b/fpga_interchange/archdefs.h
index a95049bc..d6d0a3c7 100644
--- a/fpga_interchange/archdefs.h
+++ b/fpga_interchange/archdefs.h
@@ -51,24 +51,6 @@ struct DelayInfo
 
 // -----------------------------------------------------------------------
 
-// https://bugreports.qt.io/browse/QTBUG-80789
-
-#ifndef Q_MOC_RUN
-
-enum ConstIds
-{
-    ID_NONE
-#define X(t) , ID_##t
-#include "constids.inc"
-#undef X
-};
-
-#define X(t) static constexpr auto id_##t = IdString(ID_##t);
-#include "constids.inc"
-#undef X
-
-#endif
-
 struct BelId
 {
     // Tile that contains this BEL.
diff --git a/fpga_interchange/constids.inc b/fpga_interchange/constids.inc
deleted file mode 100644
index e4d2b058..00000000
--- a/fpga_interchange/constids.inc
+++ /dev/null
@@ -1,48869 +0,0 @@
-X(PLLE2_ADV)
-X(RAMD32)
-X(PCIE_2_1)
-X(BUFH)
-X(FIFO18E1)
-X(IDELAYCTRL)
-X(DSP48E1)
-X(SRLC32E)
-X(LDPE)
-X(BUFG)
-X(ISERDESE2)
-X(RAMS64E)
-X(AND2B1L)
-X(EFUSE_USR)
-X(KEEPER)
-X(BUFG_LB)
-X(LUT6)
-X(BUFIO)
-X(GTHE2_CHANNEL)
-X(XADC)
-X(LDCE)
-X(ODDR)
-X(BUF)
-X(RAMS32)
-X(IBUF)
-X(BUFGCTRL)
-X(FRAME_ECCE2)
-X(OUT_FIFO)
-X(BSCANE2)
-X(SRL16E)
-X(ICAPE2)
-X(GTPE2_CHANNEL)
-X(RAMB18E1)
-X(BUFMRCE)
-X(PULLUP)
-X(GTHE2_COMMON)
-X(VCC)
-X(MUXF7)
-X(OBUFT_DCIEN)
-X(BUFMR)
-X(LUT1)
-X(FDSE)
-X(PHY_CONTROL)
-X(INV)
-X(MMCME2_ADV)
-X(ODELAYE2)
-X(LUT4)
-X(IBUF_INTERMDISABLE)
-X(GTPE2_COMMON)
-X(DCIRESET)
-X(OR2L)
-X(IBUFDS_IBUFDISABLE_INT)
-X(LUT2)
-X(BUFGCE)
-X(SRLC16E)
-X(PHASER_IN)
-X(PHASER_IN_PHY)
-X(CAPTUREE2)
-X(LUT5)
-X(GTXE2_CHANNEL)
-X(CARRY4)
-X(OBUFTDS_DCIEN)
-X(RAMD64E)
-X(OSERDESE2)
-X(MUXF8)
-X(IBUFDS_GTE2)
-X(PULLDOWN)
-X(GTXE2_COMMON)
-X(OBUFDS)
-X(IDELAYE2)
-X(ZHOLD_DELAY)
-X(PHASER_OUT_PHY)
-X(IBUF_IBUFDISABLE)
-X(DNA_PORT)
-X(PHASER_REF)
-X(IDELAYE2_FINEDELAY)
-X(BUFR)
-X(BUFHCE)
-X(OBUFTDS)
-X(FDRE)
-X(CFGLUT5)
-X(PCIE_3_0)
-X(MUXCY)
-X(OBUF)
-X(IBUFDS)
-X(IN_FIFO)
-X(FDCE)
-X(OBUFT)
-X(STARTUPE2)
-X(LUT3)
-X(IDDR_2CLK)
-X(MMCME2_BASE)
-X(PHASER_OUT)
-X(USR_ACCESSE2)
-X(BUFGMUX)
-X(XORCY)
-X(RAMB36E1)
-X(FDPE)
-X(ODELAYE2_FINEDELAY)
-X(IBUFDS_INTERMDISABLE_INT)
-X(AUTOBUF)
-X(PLLE2_BASE)
-X(GND)
-X(IDDR)
-X(FIFO36E1)
-X(HCLK_LEAF_CLK_B_TOPL5)
-X(HCLK_LEAF_CLK_B_TOPL4)
-X(HCLK_LEAF_CLK_B_TOPL3)
-X(HCLK_LEAF_CLK_B_TOPL2)
-X(HCLK_LEAF_CLK_B_TOPL1)
-X(HCLK_LEAF_CLK_B_TOPL0)
-X(HCLK_CK_INOUT_L5)
-X(HCLK_CK_INOUT_L6)
-X(HCLK_CK_INOUT_L7)
-X(HCLK_CK_INOUT_L4)
-X(HCLK_CK_INOUT_L3)
-X(HCLK_CK_INOUT_L2)
-X(HCLK_CK_INOUT_L1)
-X(HCLK_CK_INOUT_L0)
-X(HCLK_CK_BUFHCLK10)
-X(HCLK_CK_BUFHCLK8)
-X(HCLK_CK_BUFHCLK9)
-X(HCLK_CK_BUFRCLK3)
-X(HCLK_CK_BUFHCLK11)
-X(HCLK_CK_BUFRCLK0)
-X(HCLK_CK_BUFRCLK1)
-X(HCLK_CK_BUFRCLK2)
-X(HCLK_CK_OUTIN_L1)
-X(HCLK_CK_OUTIN_L2)
-X(HCLK_CK_OUTIN_L3)
-X(HCLK_CK_OUTIN_L4)
-X(HCLK_CK_OUTIN_L0)
-X(HCLK_CK_OUTIN_L5)
-X(HCLK_CK_OUTIN_L6)
-X(HCLK_CK_OUTIN_L7)
-X(B_TERM_UTURN_INT_SW6A0)
-X(HCLK_CCIO1)
-X(HCLK_CCIO0)
-X(B_TERM_UTURN_INT_WR1END0)
-X(B_TERM_UTURN_INT_WR1BEG0)
-X(B_TERM_UTURN_INT_SW6D0)
-X(B_TERM_UTURN_INT_SW6D1)
-X(B_TERM_UTURN_INT_SW6D2)
-X(B_TERM_UTURN_INT_SW6D3)
-X(B_TERM_UTURN_INT_SW6END_N0_3)
-X(B_TERM_UTURN_INT_SW6A2)
-X(B_TERM_UTURN_INT_SS6E1)
-X(B_TERM_UTURN_INT_SS6E3)
-X(B_TERM_UTURN_INT_SW2BEG0)
-X(B_TERM_UTURN_INT_SW2BEG1)
-X(B_TERM_UTURN_INT_SW2BEG2)
-X(B_TERM_UTURN_INT_SW2BEG3)
-X(B_TERM_UTURN_INT_SS6E2)
-X(B_TERM_UTURN_INT_SW6A1)
-X(B_TERM_UTURN_INT_SW6C3)
-X(B_TERM_UTURN_INT_SW6A3)
-X(B_TERM_UTURN_INT_SW6B0)
-X(B_TERM_UTURN_INT_SW6B1)
-X(B_TERM_UTURN_INT_SW6B2)
-X(B_TERM_UTURN_INT_SW6B3)
-X(B_TERM_UTURN_INT_SW6C0)
-X(B_TERM_UTURN_INT_SW6C1)
-X(B_TERM_UTURN_INT_SW6C2)
-X(HCLK_CK_IN4)
-X(HCLK_INT_PERFCLK3)
-X(HCLK_INT_PERFCLK2)
-X(HCLK_INT_PERFCLK1)
-X(HCLK_INT_PERFCLK0)
-X(HCLK_CK_IN13)
-X(HCLK_CK_IN12)
-X(HCLK_CK_IN11)
-X(HCLK_CK_IN10)
-X(HCLK_CK_IN9)
-X(HCLK_CK_IN8)
-X(HCLK_CK_IN7)
-X(HCLK_CK_IN6)
-X(HCLK_CK_IN5)
-X(HCLK_CCIO2)
-X(HCLK_CK_IN3)
-X(HCLK_CK_IN2)
-X(HCLK_CK_IN1)
-X(HCLK_CK_IN0)
-X(HCLK_CK_BUFHCLK7)
-X(HCLK_CK_BUFHCLK6)
-X(HCLK_CK_BUFHCLK5)
-X(HCLK_CK_BUFHCLK4)
-X(HCLK_CK_BUFHCLK3)
-X(HCLK_CK_BUFHCLK2)
-X(HCLK_CK_BUFHCLK1)
-X(HCLK_CK_BUFHCLK0)
-X(HCLK_CCIO3)
-X(B_TERM_UTURN_INT_SE2BEG2)
-X(B_TERM_UTURN_INT_LV_L3)
-X(B_TERM_UTURN_INT_LV_L4)
-X(B_TERM_UTURN_INT_LV_L5)
-X(B_TERM_UTURN_INT_LV_L6)
-X(B_TERM_UTURN_INT_LV_L7)
-X(B_TERM_UTURN_INT_LV_L8)
-X(B_TERM_UTURN_INT_LV_L9)
-X(B_TERM_UTURN_INT_LV_L18)
-X(B_TERM_UTURN_INT_SE2BEG0)
-X(B_TERM_UTURN_INT_SE2BEG1)
-X(B_TERM_UTURN_INT_LV_L2)
-X(B_TERM_UTURN_INT_SE2BEG3)
-X(B_TERM_UTURN_INT_SE6A0)
-X(B_TERM_UTURN_INT_SE6A1)
-X(B_TERM_UTURN_INT_SE6A2)
-X(B_TERM_UTURN_INT_SE6A3)
-X(B_TERM_UTURN_INT_SE6B0)
-X(B_TERM_UTURN_INT_SE6B1)
-X(B_TERM_UTURN_INT_SE6B2)
-X(B_TERM_UTURN_INT_SE6B3)
-X(B_TERM_UTURN_INT_SE6C0)
-X(B_TERM_UTURN_INT_LV7)
-X(B_TERM_UTURN_INT_ER1END_N3_3)
-X(B_TERM_UTURN_INT_FAN_BOUNCE0)
-X(B_TERM_UTURN_INT_FAN_BOUNCE2)
-X(B_TERM_UTURN_INT_FAN_BOUNCE4)
-X(B_TERM_UTURN_INT_FAN_BOUNCE6)
-X(B_TERM_UTURN_INT_LV2)
-X(B_TERM_UTURN_INT_LV3)
-X(B_TERM_UTURN_INT_LV4)
-X(B_TERM_UTURN_INT_LV5)
-X(B_TERM_UTURN_INT_LV6)
-X(B_TERM_UTURN_INT_SE6C1)
-X(B_TERM_UTURN_INT_LV8)
-X(B_TERM_UTURN_INT_LV9)
-X(B_TERM_UTURN_INT_LV18)
-X(B_TERM_UTURN_INT_LVB_L0)
-X(B_TERM_UTURN_INT_LVB_L1)
-X(B_TERM_UTURN_INT_LVB_L2)
-X(B_TERM_UTURN_INT_LVB_L3)
-X(B_TERM_UTURN_INT_LVB_L4)
-X(B_TERM_UTURN_INT_LVB_L5)
-X(B_TERM_UTURN_INT_SS6BEG2)
-X(B_TERM_UTURN_INT_SS6A0)
-X(B_TERM_UTURN_INT_SS6A1)
-X(B_TERM_UTURN_INT_SS6A2)
-X(B_TERM_UTURN_INT_SS6A3)
-X(B_TERM_UTURN_INT_SS6B0)
-X(B_TERM_UTURN_INT_SS6B1)
-X(B_TERM_UTURN_INT_SS6B2)
-X(B_TERM_UTURN_INT_SS6B3)
-X(B_TERM_UTURN_INT_SS6BEG0)
-X(B_TERM_UTURN_INT_SS6BEG1)
-X(B_TERM_UTURN_INT_SS2BEG3)
-X(B_TERM_UTURN_INT_SS6BEG3)
-X(B_TERM_UTURN_INT_SS6C0)
-X(B_TERM_UTURN_INT_SS6C1)
-X(B_TERM_UTURN_INT_SS6C2)
-X(B_TERM_UTURN_INT_SS6C3)
-X(B_TERM_UTURN_INT_SS6D0)
-X(B_TERM_UTURN_INT_SS6D1)
-X(B_TERM_UTURN_INT_SS6D2)
-X(B_TERM_UTURN_INT_SS6D3)
-X(B_TERM_UTURN_INT_SS6E0)
-X(B_TERM_UTURN_INT_SR1BEG1)
-X(B_TERM_UTURN_INT_SE6C2)
-X(B_TERM_UTURN_INT_SE6C3)
-X(B_TERM_UTURN_INT_SE6D0)
-X(B_TERM_UTURN_INT_SE6D1)
-X(B_TERM_UTURN_INT_SE6D2)
-X(B_TERM_UTURN_INT_SE6D3)
-X(B_TERM_UTURN_INT_SL1BEG0)
-X(B_TERM_UTURN_INT_SL1BEG1)
-X(B_TERM_UTURN_INT_SL1BEG2)
-X(B_TERM_UTURN_INT_SL1BEG3)
-X(B_TERM_UTURN_INT_ER1BEG0)
-X(B_TERM_UTURN_INT_SR1BEG2)
-X(B_TERM_UTURN_INT_SR1BEG3)
-X(B_TERM_UTURN_INT_SS2A0)
-X(B_TERM_UTURN_INT_SS2A1)
-X(B_TERM_UTURN_INT_SS2A2)
-X(B_TERM_UTURN_INT_SS2A3)
-X(B_TERM_UTURN_INT_SS2BEG0)
-X(B_TERM_UTURN_INT_SS2BEG1)
-X(B_TERM_UTURN_INT_SS2BEG2)
-X(HCLK_LEAF_CLK_B_TOP2)
-X(HCLK_LEAF_CLK_B_TOP1)
-X(HCLK_LEAF_CLK_B_TOP0)
-X(HCLK_LEAF_CLK_B_BOT4)
-X(HCLK_LEAF_CLK_B_BOT0)
-X(HCLK_LEAF_CLK_B_BOT1)
-X(HCLK_LEAF_CLK_B_BOT2)
-X(HCLK_LEAF_CLK_B_BOT5)
-X(HCLK_LEAF_CLK_B_BOT3)
-X(HCLK_LEAF_CLK_B_TOP3)
-X(HCLK_LEAF_CLK_B_TOP4)
-X(HCLK_LEAF_CLK_B_TOP5)
-X(HCLK_CK_INOUT_R6)
-X(HCLK_CK_INOUT_R3)
-X(HCLK_CK_INOUT_R7)
-X(HCLK_CK_INOUT_R5)
-X(HCLK_CK_INOUT_R4)
-X(HCLK_CK_INOUT_R0)
-X(HCLK_CK_INOUT_R1)
-X(HCLK_CK_INOUT_R2)
-X(HCLK_CK_OUTIN_R4)
-X(HCLK_CK_OUTIN_R0)
-X(HCLK_CK_OUTIN_R1)
-X(HCLK_CK_OUTIN_R2)
-X(HCLK_CK_OUTIN_R3)
-X(HCLK_CK_OUTIN_R5)
-X(HCLK_CK_OUTIN_R6)
-X(HCLK_CK_OUTIN_R7)
-X(HCLK_SE2A2)
-X(HCLK_SE6B1)
-X(HCLK_SE6B0)
-X(HCLK_SE2A3)
-X(HCLK_SR1END2)
-X(HCLK_SE6E0)
-X(HCLK_SS6C0)
-X(HCLK_SR1END1)
-X(HCLK_SR1BEG3)
-X(HCLK_SL1END3)
-X(HCLK_SL1END2)
-X(HCLK_SL1END1)
-X(HCLK_SL1END0)
-X(HCLK_SE6E3)
-X(HCLK_SE6E2)
-X(HCLK_SE6E1)
-X(HCLK_SE6B2)
-X(HCLK_SE6D3)
-X(HCLK_SE6D2)
-X(HCLK_SE6D1)
-X(HCLK_SE6D0)
-X(HCLK_SE6C3)
-X(HCLK_SE6C2)
-X(HCLK_SE6C1)
-X(HCLK_SE6C0)
-X(HCLK_SE6B3)
-X(HCLK_NR1BEG3)
-X(HCLK_NW6A3)
-X(HCLK_NW6A2)
-X(HCLK_NW6A1)
-X(HCLK_NW6A0)
-X(HCLK_NW2END_S0_0)
-X(HCLK_NW2A3)
-X(HCLK_NW2A2)
-X(HCLK_NW2A1)
-X(HCLK_NW2A0)
-X(HCLK_NW6B0)
-X(HCLK_NR1BEG2)
-X(HCLK_NR1BEG1)
-X(HCLK_NR1BEG0)
-X(HCLK_NN6END_S1_0)
-X(HCLK_NN6E3)
-X(HCLK_NN6E2)
-X(HCLK_NN6E1)
-X(HCLK_NN6E0)
-X(HCLK_NW6D1)
-X(HCLK_SE2A0)
-X(HCLK_REFCK_WESTCLK1)
-X(HCLK_REFCK_WESTCLK0)
-X(HCLK_REFCK_EASTCLK1)
-X(HCLK_REFCK_EASTCLK0)
-X(HCLK_NW6END_S0_0)
-X(HCLK_NW6D3)
-X(HCLK_NW6D2)
-X(HCLK_SE2A1)
-X(HCLK_NW6D0)
-X(HCLK_NW6C3)
-X(HCLK_NW6C2)
-X(HCLK_NW6C1)
-X(HCLK_NW6C0)
-X(HCLK_NW6B3)
-X(HCLK_NW6B2)
-X(HCLK_NW6B1)
-X(HCLK_SW6C3)
-X(HCLK_SS6END2)
-X(HCLK_SS6END3)
-X(HCLK_SS6END_N0_3)
-X(HCLK_SW2A3)
-X(HCLK_SW2END0)
-X(HCLK_SW2END1)
-X(HCLK_SW2END2)
-X(HCLK_SW2END_N0_3)
-X(HCLK_SW6B0)
-X(HCLK_SW6B1)
-X(HCLK_SW6B2)
-X(HCLK_SW6B3)
-X(HCLK_SW6C0)
-X(HCLK_SW6C1)
-X(HCLK_SW6C2)
-X(HCLK_SS6END1)
-X(HCLK_SW6D0)
-X(HCLK_SW6D1)
-X(HCLK_SW6D2)
-X(HCLK_SW6D3)
-X(HCLK_SW6E0)
-X(HCLK_SW6E1)
-X(HCLK_SW6E2)
-X(HCLK_SW6E3)
-X(HCLK_SW6END3)
-X(HCLK_WL1BEG3)
-X(HCLK_WL1END3)
-X(HCLK_WR1BEG_S0)
-X(HCLK_WR1END_S1_0)
-X(HCLK_WW2END3)
-X(HCLK_WW4END_S0_0)
-X(HCLK_SS6B2)
-X(HCLK_SS2A0)
-X(HCLK_SS2A1)
-X(HCLK_SS2A2)
-X(HCLK_SS2A3)
-X(HCLK_SS2BEG3)
-X(HCLK_SS2END0)
-X(HCLK_SS2END1)
-X(HCLK_SS2END2)
-X(HCLK_SS2END_N0_3)
-X(HCLK_SS6A0)
-X(HCLK_SS6A1)
-X(HCLK_SS6A2)
-X(HCLK_SS6A3)
-X(HCLK_SS6B0)
-X(HCLK_SS6B1)
-X(HCLK_SR1END_N3_3)
-X(HCLK_SS6B3)
-X(HCLK_NN6A1)
-X(HCLK_SS6C1)
-X(HCLK_SS6C2)
-X(HCLK_SS6C3)
-X(HCLK_SS6D0)
-X(HCLK_SS6D1)
-X(HCLK_SS6D2)
-X(HCLK_SS6D3)
-X(HCLK_SS6E0)
-X(HCLK_SS6E1)
-X(HCLK_SS6E2)
-X(HCLK_SS6E3)
-X(HCLK_SS6END0)
-X(HCLK_LV5)
-X(HCLK_ER1BEG_S0)
-X(HCLK_ER1END3)
-X(HCLK_FAN_BOUNCE_S3_0)
-X(HCLK_FAN_BOUNCE_S3_2)
-X(HCLK_FAN_BOUNCE_S3_4)
-X(HCLK_FAN_BOUNCE_S3_6)
-X(HCLK_LV0)
-X(HCLK_LV1)
-X(HCLK_LV2)
-X(HCLK_LV3)
-X(HCLK_LV4)
-X(HCLK_EL1END_S3_0)
-X(HCLK_LV6)
-X(HCLK_LV7)
-X(HCLK_LV8)
-X(HCLK_LV9)
-X(HCLK_LV10)
-X(HCLK_LV11)
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-X(HCLK_LV14)
-X(HCLK_LV15)
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-X(HCLK_LVB3)
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-X(HCLK_BYP_BOUNCE7)
-X(HCLK_LVB4)
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-X(HCLK_NN6B0)
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-X(HCLK_NN6BEG0)
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-X(HCLK_NN6C1)
-X(HCLK_NN6C2)
-X(HCLK_NN6C3)
-X(HCLK_NN6D0)
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-X(OUT)
-X(OUTFF)
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-X(T2_B)
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-X(D1_B)
-X(D2_B)
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-X(CLKDIVB)
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-X(D5)
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-X(D3_B)
-X(D4_B)
-X(D5_B)
-X(D6_B)
-X(D7_B)
-X(D8_B)
-X(T3_B)
-X(T4_B)
-X(CKB)
-X(Q1)
-X(Q2)
-X(DLYIN)
-X(DLYFABRIC)
-X(DLYIFF)
-X(1)
-X(S0)
-X(D_B)
-X(T)
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-X(BITSLIP)
-X(CE1)
-X(CE2)
-X(CLKDIVP)
-X(DDLY)
-X(DYNCLKDIVPSEL)
-X(DYNCLKDIVSEL)
-X(DYNCLKSEL)
-X(OCLK)
-X(OCLKB)
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-X(Q4)
-X(Q5)
-X(Q6)
-X(Q7)
-X(Q8)
-X(OCLKB_B)
-X(OCLK_B)
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-X(CNTVALUEIN0)
-X(CNTVALUEIN1)
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-X(IDATAIN)
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-X(REGRST)
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-X(CNTVALUEOUT1)
-X(CNTVALUEOUT2)
-X(CNTVALUEOUT3)
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-X(DATAOUT)
-X(IDATAIN_B)
-X(DATAIN_B)
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-X(OLOGICE2_TREVUSED)
-X(OLOGICE2_OREVUSED)
-X(OLOGICE2_OSRUSED)
-X(OLOGICE2_D1INV)
-X(OLOGICE2_D2INV)
-X(OLOGICE2_OFBUSED)
-X(OLOGICE2_TFBUSED)
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-X(CLKBINV)
-X(OSERDESE2_CLKBINV)
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-X(OSERDESE2_CLKDIVINV)
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-X(OSERDESE2_CLKDIVBINV)
-X(CLKDIVFINV)
-X(OSERDESE2_CLKDIVFINV)
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-X(D8INV)
-X(OSERDESE2_D8INV)
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-X(T3INV)
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-X(T4INV)
-X(OSERDESE2_T4INV)
-X(IFF)
-X(ILOGICE3_IFF)
-X(ILOGICE3_ZHOLD_DELAY)
-X(D2OBYP_TSMUX_GND)
-X(HARD0)
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-X(DINV)
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-X(ILOGICE3_D2OBYP_SEL)
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-X(ILOGICE3_IMUX)
-X(IFFMUX)
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-X(REVUSED)
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-X(IDELMUXE3)
-X(ILOGICE3_IDELMUXE3)
-X(IFFDELMUXE3)
-X(ILOGICE3_IFFDELMUXE3)
-X(ZHOLD_IFF_INV)
-X(ILOGICE3_ZHOLD_IFF_INV)
-X(ZHOLD_FABRIC_INV)
-X(ILOGICE3_ZHOLD_FABRIC_INV)
-X(ILOGICE2_IFF)
-X(ILOGICE2_DINV)
-X(ILOGICE2_CLKINV)
-X(ILOGICE2_CLKBINV)
-X(ILOGICE2_D2OBYP_SEL)
-X(ILOGICE2_D2OFFBYP_SEL)
-X(ILOGICE2_IMUX)
-X(ILOGICE2_IFFMUX)
-X(ILOGICE2_CE1USED)
-X(ILOGICE2_SRUSED)
-X(ILOGICE2_REVUSED)
-X(IDELMUX)
-X(ILOGICE2_IDELMUX)
-X(IFFDELMUX)
-X(ILOGICE2_IFFDELMUX)
-X(ISERDESE2_ISERDESE2)
-X(OCLKBINV)
-X(ISERDESE2_OCLKBINV)
-X(OCLKINV)
-X(ISERDESE2_OCLKINV)
-X(ISERDESE2_DINV)
-X(CLKDIVPINV)
-X(ISERDESE2_CLKDIVPINV)
-X(ISERDESE2_CLKDIVINV)
-X(ISERDESE2_CLKBINV)
-X(ISERDESE2_CLKINV)
-X(IDELAYE2_IDELAYE2)
-X(IDATAININV)
-X(IDELAYE2_IDATAININV)
-X(DATAININV)
-X(IDELAYE2_DATAININV)
-X(CINV)
-X(IDELAYE2_CINV)
-X(IOI_OCLK_0)
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-X(IOI_LOGIC_OUTS19_1)
-X(IOI_LOGIC_OUTS3_1)
-X(IOI_LOGIC_OUTS5_0)
-X(IOI_LOGIC_OUTS5_1)
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-X(IOI_IMUX_RC0)
-X(IOI_IMUX_RC1)
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-X(IOI_LOGIC_OUTS0_0)
-X(IOI_LOGIC_OUTS0_1)
-X(IOI_LOGIC_OUTS10_0)
-X(IOI_LOGIC_OUTS10_1)
-X(IOI_LOGIC_OUTS8_1)
-X(IOI_LOGIC_OUTS11_1)
-X(IOI_LOGIC_OUTS14_0)
-X(IOI_LOGIC_OUTS14_1)
-X(IOI_LOGIC_OUTS15_0)
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-X(IOI_LOGIC_OUTS18_0)
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-X(RIOI_T0)
-X(RIOI_PU_INT_EN_1)
-X(RIOI_PU_INT_EN_0)
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-X(RIOI_OLOGIC1_TFB_LOCAL)
-X(RIOI_OLOGIC0_TFB_LOCAL)
-X(RIOI_O1)
-X(RIOI_O0)
-X(RIOI_KEEPER_INT_EN_1)
-X(RIOI_KEEPER_INT_EN_0)
-X(RIOI_IBUF_DISABLE1)
-X(RIOI_IBUF_DISABLE0)
-X(RIOI_I1)
-X(IOI_LOGIC_OUTS7_1)
-X(RIOI_DIFF_TERM_INT_EN)
-X(RIOI_DCI_T_TERM1)
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-X(IOI_LOGIC_OUTS9_0)
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-X(IOI_LOGIC_OUTS8_0)
-X(IOI_BLOCK_OUTS0_1)
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-X(IOI_IDELAY0_CNTVALUEOUT0)
-X(IOI_IDELAY0_CNTVALUEOUT1)
-X(IOI_IDELAY0_CNTVALUEOUT2)
-X(IOI_IDELAY0_CNTVALUEOUT3)
-X(IOI_IDELAY0_CNTVALUEOUT4)
-X(IOI_ILOGIC1_Q4)
-X(IOI_ILOGIC1_Q8)
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-X(IOI_ILOGIC1_Q6)
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-X(IOI_ILOGIC1_OCLKB)
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-X(RIOI_ILOGIC1_D)
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-X(RIOI_ILOGIC1_OFB)
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-X(RIOI_ILOGIC0_DDLY)
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-X(RIOI3_IDELAY0_IFDLY1)
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-X(IOI_ILOGIC1_REV)
-X(IOI_OLOGIC1_D8)
-X(IOI_OLOGIC1_OCE)
-X(IOI_OLOGIC1_REV)
-X(IOI_OLOGIC1_SR)
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-X(IOI_ILOGIC0_CLKDIV)
-X(IOI_ILOGIC0_CLKDIVP)
-X(IOI_ILOGIC0_DYNCLKDIVPSEL)
-X(IOI_ILOGIC0_DYNCLKDIVSEL)
-X(IOI_ILOGIC0_DYNCLKSEL)
-X(IOI_ILOGIC0_OCLK)
-X(IOI_IDELAY1_DATAIN)
-X(IOI_IDELAY0_CNTVALUEIN1)
-X(IOI_IDELAY0_CNTVALUEIN2)
-X(IOI_IDELAY0_CNTVALUEIN3)
-X(IOI_IDELAY0_CNTVALUEIN4)
-X(IOI_IDELAY0_DATAIN)
-X(IOI_IDELAY0_INC)
-X(IOI_IDELAY0_LD)
-X(IOI_IDELAY0_LDPIPEEN)
-X(IOI_IDELAY0_REGRST)
-X(IOI_IDELAY1_C)
-X(IOI_IDELAY1_CE)
-X(IOI_IDELAY1_CINVCTRL)
-X(IOI_IDELAY1_CNTVALUEIN0)
-X(IOI_IDELAY1_CNTVALUEIN1)
-X(IOI_IDELAY1_CNTVALUEIN2)
-X(IOI_IDELAY1_CNTVALUEIN3)
-X(IOI_IDELAY1_CNTVALUEIN4)
-X(IOI_RCLK_FORIO0)
-X(IOI_LEAF_GCLK5)
-X(IOI_RCLK_FORIO3)
-X(IOI_RCLK_FORIO2)
-X(IOI_RCLK_FORIO1)
-X(IOI_LEAF_GCLK4)
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-X(GTPE2_CHANNEL_DRPDO6)
-X(GTPE2_CHANNEL_DRPDO5)
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-X(GTPE2_CHANNEL_PCSRSVDOUT13)
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-X(GTPE2_CHANNEL_PCSRSVDOUT10)
-X(GTPE2_CHANNEL_PCSRSVDOUT9)
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-X(GTPE2_CHANNEL_DMONITOROUT0)
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-X(GTPE2_CHANNEL_RXCHARISK2)
-X(GTPE2_CHANNEL_RXCHARISK1)
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-X(GTPE2_CHANNEL_TXPIPPMPD)
-X(GTPE2_CHANNEL_TXPIPPMOVRDEN)
-X(GTPE2_CHANNEL_PCSRSVDIN10)
-X(GTPE2_CHANNEL_TXPIPPMEN)
-X(GTPE2_CHANNEL_TXPHALIGNEN)
-X(GTPE2_CHANNEL_TXPDELECIDLEMODE)
-X(GTPE2_CHANNEL_TXPHOVRDEN)
-X(GTPE2_CHANNEL_TXPHDLYPD)
-X(GTPE2_CHANNEL_TXPHDLYRESET)
-X(GTPE2_CHANNEL_TXPHDLYTSTCLK)
-X(GTPE2_CHANNEL_TXPHINIT)
-X(GTPE2_CHANNEL_PCSRSVDIN9)
-X(GTPE2_CHANNEL_TXDATA26)
-X(GTPE2_CHANNEL_TXDIFFCTRL2)
-X(GTPE2_CHANNEL_TXPRBSSEL1)
-X(GTPE2_CHANNEL_TXPRBSSEL0)
-X(GTPE2_CHANNEL_TXPRBSFORCEERR)
-X(GTPE2_CHANNEL_TXPOSTCURSORINV)
-X(GTPE2_CHANNEL_TXPOSTCURSOR4)
-X(GTPE2_CHANNEL_TXPOSTCURSOR3)
-X(GTPE2_CHANNEL_TXPOSTCURSOR2)
-X(GTPE2_CHANNEL_TXPOSTCURSOR1)
-X(GTPE2_CHANNEL_TXPOSTCURSOR0)
-X(GTPE2_CHANNEL_TXDATA25)
-X(GTPE2_CHANNEL_TXPIPPMSEL)
-X(GTPE2_CHANNEL_TXDATA27)
-X(GTPE2_CHANNEL_TXDATA28)
-X(GTPE2_CHANNEL_TXPOLARITY)
-X(GTPE2_CHANNEL_PCSRSVDIN8)
-X(GTPE2_CHANNEL_TXPMARESET)
-X(GTPE2_CHANNEL_TXPISOPD)
-X(GTPE2_CHANNEL_TXPIPPMSTEPSIZE4)
-X(GTPE2_CHANNEL_TXPIPPMSTEPSIZE3)
-X(GTPE2_CHANNEL_TXPIPPMSTEPSIZE2)
-X(GTPE2_CHANNEL_TXPIPPMSTEPSIZE1)
-X(GTPE2_CHANNEL_TXPIPPMSTEPSIZE0)
-X(GTPE2_CHANNEL_TXELECIDLE)
-X(GTPE2_CHANNEL_TXDATA29)
-X(GTPE2_CHANNEL_TXDATA30)
-X(GTPE2_CHANNEL_TXDATA31)
-X(GTPE2_CHANNEL_TXMAINCURSOR0)
-X(GTPE2_CHANNEL_TXINHIBIT)
-X(GTPE2_CHANNEL_TXDEEMPH)
-X(GTPE2_CHANNEL_TXDETECTRX)
-X(GTPE2_CHANNEL_TXHEADER1)
-X(GTPE2_CHANNEL_TXHEADER0)
-X(GTPE2_CHANNEL_TXDIFFCTRL0)
-X(GTPE2_CHANNEL_TXSYNCMODE)
-X(GTPE2_CHANNEL_TXDLYUPDOWN)
-X(GTPE2_CHANNEL_TXDLYTESTENB)
-X(GTPE2_CHANNEL_TXDIFFCTRL1)
-X(GTPE2_CHANNEL_TXDLYSRESET)
-X(GTPE2_CHANNEL_TXDLYOVRDEN)
-X(GTPE2_CHANNEL_TXDLYHOLD)
-X(GTPE2_CHANNEL_TXDLYEN)
-X(GTPE2_CHANNEL_TXDLYBYPASS)
-X(GTPE2_CHANNEL_TXDIFFPD)
-X(GTPE2_CHANNEL_TXDIFFCTRL3)
-X(GTPE2_CHANNEL_TXN_PAD)
-X(GTPE2_CHANNEL_TXPD0)
-X(GTPE2_CHANNEL_TXPCSRESET)
-X(GTPE2_CHANNEL_PCSRSVDIN11)
-X(GTPE2_CHANNEL_PCSRSVDIN12)
-X(GTPE2_CHANNEL_PCSRSVDIN13)
-X(GTPE2_CHANNEL_PCSRSVDIN14)
-X(GTPE2_CHANNEL_PCSRSVDIN15)
-X(GTPE2_CHANNEL_TXOUTCLKSEL2)
-X(GTPE2_CHANNEL_TXOUTCLKSEL1)
-X(GTPE2_CHANNEL_TXOUTCLKSEL0)
-X(GTPE2_CHANNEL_TXPD1)
-X(GTPE2_CHANNEL_TXMARGIN2)
-X(GTPE2_CHANNEL_TXMARGIN1)
-X(GTPE2_CHANNEL_TXMARGIN0)
-X(GTPE2_CHANNEL_TXMAINCURSOR6)
-X(GTPE2_CHANNEL_TXMAINCURSOR5)
-X(GTPE2_CHANNEL_TXMAINCURSOR4)
-X(GTPE2_CHANNEL_TXMAINCURSOR3)
-X(GTPE2_CHANNEL_TXMAINCURSOR2)
-X(GTPE2_CHANNEL_TXMAINCURSOR1)
-X(GTPE2_CHANNEL_EYESCANTRIGGER)
-X(GTPE2_CHANNEL_DRPDI9)
-X(GTPE2_CHANNEL_DRPDI10)
-X(GTPE2_CHANNEL_DRPDI11)
-X(GTPE2_CHANNEL_DRPDI12)
-X(GTPE2_CHANNEL_DRPDI13)
-X(GTPE2_CHANNEL_DRPDI14)
-X(GTPE2_CHANNEL_DRPDI15)
-X(GTPE2_CHANNEL_DRPEN)
-X(GTPE2_CHANNEL_DRPWE)
-X(GTPE2_CHANNEL_EYESCANMODE)
-X(GTPE2_CHANNEL_EYESCANRESET)
-X(GTPE2_CHANNEL_DRPDI8)
-X(GTPE2_CHANNEL_GTRESETSEL)
-X(GTPE2_CHANNEL_GTRSVD0)
-X(GTPE2_CHANNEL_GTRSVD1)
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-X(GTPE2_CHANNEL_GTRSVD3)
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-X(GTPE2_CHANNEL_GTRSVD5)
-X(GTPE2_CHANNEL_GTRSVD6)
-X(GTPE2_CHANNEL_GTRSVD7)
-X(GTPE2_CHANNEL_GTRSVD8)
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-X(GTPE2_CHANNEL_DRPADDR6)
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-X(GTPE2_CHANNEL_GTRSVD10)
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-X(GTPE2_CHANNEL_DRPDI5)
-X(GTPE2_CHANNEL_DRPDI6)
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-X(GTPE2_CHANNEL_TXRATEMODE)
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-X(GTPE2_CHANNEL_TXSEQUENCE3)
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-X(GTPE2_CHANNEL_PCSRSVDIN2)
-X(GTPE2_CHANNEL_PCSRSVDIN3)
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-X(GTPE2_CHANNEL_TXSEQUENCE6)
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-X(GTPE2_CHANNEL_TXRATE2)
-X(GTPE2_CHANNEL_TXRATE1)
-X(GTPE2_CHANNEL_TXRATE0)
-X(GTPE2_CHANNEL_TXP_PAD)
-X(GTPE2_CHANNEL_TXPRECURSORINV)
-X(GTPE2_CHANNEL_TXPRECURSOR4)
-X(GTPE2_CHANNEL_TXPRECURSOR3)
-X(GTPE2_CHANNEL_TXPRECURSOR2)
-X(GTPE2_CHANNEL_TXPRECURSOR1)
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-X(GTPE2_CHANNEL_TXUSRCLK)
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-X(GTPE2_CHANNEL_GTRXRESET)
-X(GTPE2_CHANNEL_GTTXRESET)
-X(GTPE2_CHANNEL_LOOPBACK0)
-X(GTPE2_CHANNEL_LOOPBACK1)
-X(GTPE2_CHANNEL_LOOPBACK2)
-X(GTPE2_CHANNEL_TXUSRCLK2)
-X(GTPE2_CHANNEL_TXPRBSSEL2)
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-X(GTPE2_CHANNEL_TXSYSCLKSEL1)
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-X(GTPE2_CHANNEL_PCSRSVDIN0)
-X(GTPE2_CHANNEL_TXHEADER2)
-X(GTPE2_CHANNEL_TXSYNCIN)
-X(GTPE2_CHANNEL_PCSRSVDIN1)
-X(GTPE2_CHANNEL_TXSYNCALLIN)
-X(GTPE2_CHANNEL_TXSWING)
-X(GTPE2_CHANNEL_TXSTARTSEQ)
-X(GTPE2_CHANNEL_RXOSINTNTRLEN)
-X(GTPE2_CHANNEL_PMASCANIN3)
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-X(GTPE2_CHANNEL_RXOUTCLKSEL1)
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-X(GTPE2_CHANNEL_PMASCANIN5)
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-X(GTPE2_CHANNEL_RXOSOVRDEN)
-X(GTPE2_CHANNEL_RXOSINTTESTOVRDEN)
-X(GTPE2_CHANNEL_PMASCANMODEB)
-X(GTPE2_CHANNEL_RXOSINTSTROBE)
-X(GTPE2_CHANNEL_RXOSINTPD)
-X(GTPE2_CHANNEL_RXOSINTOVRDEN)
-X(GTPE2_CHANNEL_PMASCANIN2)
-X(GTPE2_CHANNEL_RXOSINTID03)
-X(GTPE2_CHANNEL_RXOSINTID02)
-X(GTPE2_CHANNEL_RXOSINTID01)
-X(GTPE2_CHANNEL_RXOSINTID00)
-X(GTPE2_CHANNEL_RXOSINTHOLD)
-X(GTPE2_CHANNEL_RXOSINTEN)
-X(GTPE2_CHANNEL_RXOSINTCFG3)
-X(GTPE2_CHANNEL_RXOSINTCFG2)
-X(GTPE2_CHANNEL_RXOSINTCFG1)
-X(GTPE2_CHANNEL_RXOSINTCFG0)
-X(GTPE2_CHANNEL_RXOSHOLD)
-X(GTPE2_CHANNEL_RXOSCALRESET)
-X(GTPE2_CHANNEL_PMASCANCLK3)
-X(GTPE2_CHANNEL_RXPRBSSEL1)
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-X(GTPE2_CHANNEL_RXPRBSCNTRESET)
-X(GTPE2_CHANNEL_RXPOLARITY)
-X(GTPE2_CHANNEL_PMARSVDIN1)
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-X(GTPE2_CHANNEL_PMARSVDIN2)
-X(GTPE2_CHANNEL_PMARSVDIN3)
-X(GTPE2_CHANNEL_PMARSVDIN4)
-X(GTPE2_CHANNEL_RXPHOVRDEN)
-X(GTPE2_CHANNEL_PMASCANCLK0)
-X(GTPE2_CHANNEL_PMASCANCLK1)
-X(GTPE2_CHANNEL_PMASCANCLK2)
-X(GTPE2_CHANNEL_RXOOBRESET)
-X(GTPE2_CHANNEL_PMASCANENB)
-X(GTPE2_CHANNEL_RXPHDLYRESET)
-X(GTPE2_CHANNEL_RXPHDLYPD)
-X(GTPE2_CHANNEL_RXPHALIGNEN)
-X(GTPE2_CHANNEL_PMASCANIN0)
-X(GTPE2_CHANNEL_RXPHALIGN)
-X(GTPE2_CHANNEL_RXPD1)
-X(GTPE2_CHANNEL_RXPD0)
-X(GTPE2_CHANNEL_RXPCSRESET)
-X(GTPE2_CHANNEL_RXPCOMMAALIGNEN)
-X(GTPE2_CHANNEL_RXP)
-X(GTPE2_CHANNEL_PMASCANIN1)
-X(GTPE2_CHANNEL_RXCDRRESET)
-X(GTPE2_CHANNEL_RXDFEXYDEN)
-X(GTPE2_CHANNEL_RXDEBUGPULSE)
-X(GTPE2_CHANNEL_RXDDIEN)
-X(GTPE2_CHANNEL_RXADAPTSELTEST8)
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-X(GTPE2_CHANNEL_RXADAPTSELTEST10)
-X(GTPE2_CHANNEL_RXADAPTSELTEST11)
-X(GTPE2_CHANNEL_RXADAPTSELTEST12)
-X(GTPE2_CHANNEL_RXADAPTSELTEST13)
-X(GTPE2_CHANNEL_RXBUFRESET)
-X(GTPE2_CHANNEL_RXCDRFREQRESET)
-X(GTPE2_CHANNEL_RXCDRHOLD)
-X(GTPE2_CHANNEL_RXCDROVRDEN)
-X(GTPE2_CHANNEL_RXADAPTSELTEST7)
-X(GTPE2_CHANNEL_RXCDRRESETRSV)
-X(GTPE2_CHANNEL_RXCHBONDEN)
-X(GTPE2_CHANNEL_RXCHBONDI0)
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-X(GTPE2_CHANNEL_RXCHBONDI2)
-X(GTPE2_CHANNEL_RXCHBONDI3)
-X(GTPE2_CHANNEL_RXCHBONDLEVEL0)
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-X(GTPE2_CHANNEL_RXCOMMADETEN)
-X(GTPE2_CHANNEL_RXCHBONDLEVEL2)
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-X(GTPE2_CHANNEL_RXN)
-X(GTPE2_CHANNEL_RXMCOMMAALIGNEN)
-X(GTPE2_CHANNEL_RXLPMRESET)
-X(GTPE2_CHANNEL_RXLPMOSINTNTRLEN)
-X(GTPE2_CHANNEL_RXLPMLFOVRDEN)
-X(GTPE2_CHANNEL_RXLPMLFHOLD)
-X(GTPE2_CHANNEL_RXLPMHFOVRDEN)
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-X(GTPE2_CHANNEL_RESETOVRD)
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-X(GTPE2_CHANNEL_RXELECIDLEMODE1)
-X(GTPE2_CHANNEL_RXELECIDLEMODE0)
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-X(GTPE2_CHANNEL_RXDLYBYPASS)
-X(GTPE2_CHANNEL_RXADAPTSELTEST4)
-X(GTPE2_CHANNEL_RXADAPTSELTEST5)
-X(GTPE2_CHANNEL_RXADAPTSELTEST6)
-X(GTPE2_CHANNEL_TXBUFDIFFCTRL0)
-X(GTPE2_CHANNEL_TSTPD3)
-X(GTPE2_CHANNEL_TSTPD4)
-X(GTPE2_CHANNEL_TSTPDOVRDB)
-X(GTPE2_CHANNEL_TX8B10BBYPASS0)
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-X(GTPE2_CHANNEL_TXCHARDISPMODE0)
-X(GTPE2_CHANNEL_TXCHARDISPMODE1)
-X(GTPE2_CHANNEL_TXCHARDISPMODE2)
-X(GTPE2_CHANNEL_TXCHARDISPMODE3)
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-X(GTPE2_CHANNEL_TSTIN14)
-X(GTPE2_CHANNEL_TSTIN6)
-X(GTPE2_CHANNEL_TSTIN7)
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-X(GTPE2_CHANNEL_TSTIN9)
-X(GTPE2_CHANNEL_TSTIN10)
-X(GTPE2_CHANNEL_TSTIN11)
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-X(GTPE2_CHANNEL_TXCHARDISPVAL1)
-X(GTPE2_CHANNEL_TSTIN15)
-X(GTPE2_CHANNEL_TSTIN16)
-X(GTPE2_CHANNEL_TSTIN17)
-X(GTPE2_CHANNEL_TSTIN18)
-X(GTPE2_CHANNEL_TSTIN19)
-X(GTPE2_CHANNEL_TSTPD0)
-X(GTPE2_CHANNEL_TSTPD1)
-X(GTPE2_CHANNEL_TXDATA15)
-X(GTPE2_CHANNEL_TXDATA7)
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-X(GTPE2_CHANNEL_TXDATA9)
-X(GTPE2_CHANNEL_TXDATA10)
-X(GTPE2_CHANNEL_TXDATA11)
-X(GTPE2_CHANNEL_TXDATA12)
-X(GTPE2_CHANNEL_TXDATA13)
-X(GTPE2_CHANNEL_TXDATA14)
-X(GTPE2_CHANNEL_TXDATA6)
-X(GTPE2_CHANNEL_TXDATA16)
-X(GTPE2_CHANNEL_TXDATA17)
-X(GTPE2_CHANNEL_TXDATA18)
-X(GTPE2_CHANNEL_TXDATA19)
-X(GTPE2_CHANNEL_TXDATA20)
-X(GTPE2_CHANNEL_TXDATA21)
-X(GTPE2_CHANNEL_TXDATA22)
-X(GTPE2_CHANNEL_RXPRBSSEL2)
-X(GTPE2_CHANNEL_TXDATA5)
-X(GTPE2_CHANNEL_TXDATA4)
-X(GTPE2_CHANNEL_TXDATA3)
-X(GTPE2_CHANNEL_TXDATA2)
-X(GTPE2_CHANNEL_TXDATA1)
-X(GTPE2_CHANNEL_TXDATA0)
-X(GTPE2_CHANNEL_TXCOMWAKE)
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-X(GTPE2_CHANNEL_TXCHARISK3)
-X(GTPE2_CHANNEL_TXCHARISK2)
-X(GTPE2_CHANNEL_TXCHARISK1)
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-X(GTPE2_CHANNEL_TXCHARDISPVAL3)
-X(GTPE2_CHANNEL_TXCHARDISPVAL2)
-X(GTPE2_CHANNEL_RXSYNCMODE)
-X(GTPE2_CHANNEL_SCANIN4)
-X(GTPE2_CHANNEL_SCANIN3)
-X(GTPE2_CHANNEL_SCANIN2)
-X(GTPE2_CHANNEL_SCANIN1)
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-X(GTPE2_CHANNEL_SCANENB)
-X(GTPE2_CHANNEL_SCANCLK)
-X(GTPE2_CHANNEL_RXUSRCLK2)
-X(GTPE2_CHANNEL_RXUSRCLK)
-X(GTPE2_CHANNEL_RXUSERRDY)
-X(GTPE2_CHANNEL_RXSYSCLKSEL1)
-X(GTPE2_CHANNEL_RXSYSCLKSEL0)
-X(GTPE2_CHANNEL_TSTIN5)
-X(GTPE2_CHANNEL_RXSYNCIN)
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-X(GTPE2_CHANNEL_PLL0CLK)
-X(GTPE2_CHANNEL_PLL0REFCLK)
-X(GTPE2_CHANNEL_PLL1CLK)
-X(GTPE2_CHANNEL_PLL1REFCLK)
-X(GTPE2_CHANNEL_RXSLIDE)
-X(GTPE2_CHANNEL_RXRATEMODE)
-X(GTPE2_CHANNEL_RXRATE2)
-X(GTPE2_CHANNEL_RXRATE1)
-X(GTPE2_CHANNEL_RXRATE0)
-X(GTPE2_CHANNEL_PMARSVDIN0)
-X(GTPE2_CHANNEL_TSTIN4)
-X(GTPE2_CHANNEL_TSTIN0)
-X(GTPE2_CHANNEL_TSTIN1)
-X(GTPE2_CHANNEL_TSTCLK1)
-X(GTPE2_CHANNEL_SIGVALIDCLK)
-X(GTPE2_CHANNEL_SETERRSTATUS)
-X(GTPE2_CHANNEL_TSTCLK0)
-X(GTPE2_CHANNEL_TSTIN3)
-X(GTPE2_CHANNEL_SCANIN5)
-X(GTPE2_CHANNEL_SCANMODEB)
-X(GTPE2_CHANNEL_TSTIN2)
-X(GTPE2_IMUX27_1)
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-X(GTPE2_IMUX26_9)
-X(GTPE2_IMUX6_6)
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-X(GTPE2_IMUX6_5)
-X(GTPE2_IMUX32_5)
-X(GTPE2_IMUX6_8)
-X(GTPE2_IMUX8_9)
-X(GTPE2_IMUX6_9)
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-X(GTPE2_IMUX8_7)
-X(GTPE2_IMUX27_5)
-X(GTPE2_IMUX8_6)
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-X(GTPE2_IMUX27_10)
-X(GTPE2_IMUX31_8)
-X(GTPE2_IMUX8_4)
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-X(GTPE2_IMUX46_2)
-X(GTPE2_IMUX5_10)
-X(GTPE2_IMUX33_5)
-X(GTPE2_IMUX6_0)
-X(GTPE2_IMUX25_3)
-X(GTPE2_IMUX6_1)
-X(GTPE2_IMUX33_2)
-X(GTPE2_IMUX25_4)
-X(GTPE2_IMUX6_4)
-X(GTPE2_IMUX25_5)
-X(GTPE2_IMUX25_6)
-X(GTPE2_IMUX25_7)
-X(GTPE2_IMUX25_8)
-X(GTPE2_IMUX26_8)
-X(GTPE2_IMUX25_10)
-X(GTPE2_IMUX8_10)
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-X(GTPE2_IMUX32_9)
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-X(GTPE2_IMUX26_4)
-X(GTPE2_IMUX26_5)
-X(GTPE2_IMUX32_7)
-X(GTPE2_IMUX32_6)
-X(GTPE2_IMUX7_4)
-X(GTPE2_IMUX26_6)
-X(GTPE2_IMUX26_7)
-X(GTPE2_IMUX30_10)
-X(GTPE2_IMUX8_0)
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-X(GTPE2_IMUX28_10)
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-X(GTPE2_IMUX29_8)
-X(GTPE2_IMUX7_6)
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-X(GTPE2_IMUX30_2)
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-X(GTPE2_IMUX8_3)
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-X(GTPE2_IMUX28_6)
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-X(GTPE2_IMUX41_1)
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-X(GTPE2_IMUX42_4)
-X(GTPE2_IMUX42_5)
-X(GTPE2_IMUX42_6)
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-X(GTPE2_IMUX42_8)
-X(GTPE2_IMUX42_9)
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-X(O1)
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-X(SLICEM_WEMUX)
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-X(HCLK_CLB_CK_BUFHCLK3)
-X(HCLK_CLB_CK_BUFHCLK4)
-X(HCLK_CLB_CK_BUFHCLK5)
-X(HCLK_CLB_CK_BUFHCLK6)
-X(HCLK_CLB_CK_BUFHCLK7)
-X(HCLK_CLB_CK_BUFHCLK8)
-X(HCLK_CLB_CK_BUFHCLK9)
-X(HCLK_CLB_CK_BUFHCLK10)
-X(HCLK_CLB_CK_BUFHCLK0)
-X(HCLK_CLB_CK_BUFRCLK0)
-X(HCLK_CLB_CK_BUFRCLK1)
-X(HCLK_CLB_CK_BUFRCLK2)
-X(HCLK_CLB_CK_BUFRCLK3)
-X(HCLK_CLB_CK_IN0)
-X(HCLK_CLB_CK_IN1)
-X(HCLK_CLB_CK_IN2)
-X(HCLK_CLB_CK_IN3)
-X(HCLK_CLB_CK_IN4)
-X(CLBLL_LOGIC_OUTS13)
-X(CLBLL_LOGIC_OUTS7)
-X(CLBLL_LOGIC_OUTS6)
-X(CLBLL_LOGIC_OUTS8)
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-X(CLBLL_LOGIC_OUTS10)
-X(CLBLL_LOGIC_OUTS5)
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-X(CLBLL_LOGIC_OUTS3)
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-X(CLBLL_L_COUT_N)
-X(CLBLL_LOGIC_OUTS15)
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-X(CLBLL_LOGIC_OUTS20)
-X(CLBLL_LOGIC_OUTS21)
-X(CLBLL_LOGIC_OUTS22)
-X(CLBLL_LOGIC_OUTS23)
-X(CLBLL_LL_COUT_N)
-X(CLBLL_L_AQ)
-X(CLBLL_L_B)
-X(CLBLL_L_A)
-X(CLBLL_LL_COUT)
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-X(CLBLL_LL_CMUX)
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-X(CLBLL_LL_DMUX)
-X(CLBLL_LL_DQ)
-X(CLBLL_LL_AMUX)
-X(CLBLL_LL_AQ)
-X(CLBLL_L_D)
-X(CLBLL_L_COUT)
-X(CLBLL_L_CMUX)
-X(CLBLL_LL_B)
-X(CLBLL_LL_CQ)
-X(CLBLL_LL_BMUX)
-X(CLBLL_LL_BQ)
-X(CLBLL_L_C)
-X(CLBLL_LL_C)
-X(CLBLL_L_BMUX)
-X(CLBLL_LL_A4)
-X(CLBLL_LL_D1)
-X(CLBLL_LL_CX)
-X(CLBLL_LL_D2)
-X(CLBLL_LL_B5)
-X(CLBLL_LL_A3)
-X(CLBLL_LL_A2)
-X(CLBLL_LL_A1)
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-X(CLBLL_L_C3)
-X(CLBLL_L_C4)
-X(CLBLL_L_C5)
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-X(CLBLL_LL_DX)
-X(CLBLL_LL_SR)
-X(CLBLL_L_A1)
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-X(CLBLL_WW4A1)
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-X(CLBLL_WW4END1)
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-X(CLBLL_WR1END2)
-X(CLBLL_WR1END3)
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-X(ENCALIB1)
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-X(COUNTERREADVAL1)
-X(COUNTERREADVAL2)
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-X(COUNTERREADVAL5)
-X(COUNTERREADVAL6)
-X(COUNTERREADVAL7)
-X(COUNTERREADVAL8)
-X(CTSBUS0)
-X(CTSBUS1)
-X(DQSBUS0)
-X(DQSBUS1)
-X(DTSBUS0)
-X(DTSBUS1)
-X(FINEOVERFLOW)
-X(OCLKDELAYED)
-X(OCLKDIV)
-X(OSERDESRST)
-X(RDENABLE)
-X(SCANOUT)
-X(ENSTG1)
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-X(RANKSEL0)
-X(RANKSEL1)
-X(RANKSELPHY0)
-X(RANKSELPHY1)
-X(RSTDQSFIND)
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-X(STG1INCDEC)
-X(STG1LOAD)
-X(STG1READ)
-X(STG1REGL0)
-X(STG1REGL1)
-X(STG1REGL2)
-X(STG1REGL3)
-X(STG1REGL4)
-X(STG1REGL5)
-X(STG1REGL6)
-X(STG1REGL7)
-X(STG1REGL8)
-X(DQSFOUND)
-X(DQSOUTOFRANGE)
-X(ICLK)
-X(ICLKDIV)
-X(ISERDESRST)
-X(PHASELOCKED)
-X(RCLK)
-X(STG1OVERFLOW)
-X(STG1REGR0)
-X(STG1REGR1)
-X(STG1REGR2)
-X(STG1REGR3)
-X(STG1REGR4)
-X(STG1REGR5)
-X(STG1REGR6)
-X(STG1REGR7)
-X(STG1REGR8)
-X(WRENABLE)
-X(PHASER_REF_PHASER_REF)
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-X(PHASER_REF_RSTINV)
-X(PHY_CONTROL_PHY_CONTROL)
-X(PHASER_OUT_PHY_PHASER_OUT_PHY)
-X(PHASER_OUT_PHY_RSTINV)
-X(PHASER_OUT_PHASER_OUT)
-X(PHASER_OUT_RSTINV)
-X(PHASER_OUT_ADV)
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-X(PHASER_OUT_ADV_RSTINV)
-X(PHASER_IN_PHY_PHASER_IN_PHY)
-X(PHASER_IN_PHY_RSTINV)
-X(PHASER_IN_PHASER_IN)
-X(PHASER_IN_RSTINV)
-X(PHASER_IN_ADV)
-X(PHASER_IN_ADV_PHASER_IN_ADV)
-X(PHASER_IN_ADV_RSTINV)
-X(CMT_PHASERREF_PHASERIN_D)
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-X(CMT_PHASERREF_PHASEROUT_C)
-X(CMT_PHASERREF_PHASEROUT_D)
-X(CMT_FREQ_PHASER_REFMUX_0)
-X(CMT_FREQ_PHASER_REFMUX_1)
-X(CMT_FREQ_PHASER_REFMUX_2)
-X(PLLOUT_CLK_FREQ_BB_REBUFOUT2)
-X(PLLOUT_CLK_FREQ_BB_REBUFOUT0)
-X(PLLOUT_CLK_FREQ_BB_REBUFOUT1)
-X(PLLOUT_CLK_FREQ_BB_REBUFOUT3)
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-X(CMT_PHY_CONTROL_IRANKA1)
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-X(CMT_PHY_CONTROL_IBURSTPENDING3)
-X(CMT_PHY_CONTROL_IBURSTPENDING2)
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-X(CMT_PHASER_UP_BUFMRCE_CE1)
-X(CMT_PHASER_UP_BUFMRCE_CE0)
-X(CMT_PHASER_TOP_SYNC_BB)
-X(CMT_PHASER_REF_TMUXOUT_TOHCLK)
-X(CMT_PHASER_REF_CLKOUT_TOHCLK)
-X(CMT_PHASER_OUT_D_OCLKDIV)
-X(CMT_PHASER_OUT_D_OCLK1X_90)
-X(CMT_PHASER_OUT_D_OCLK)
-X(CMT_PHASER_OUT_C_OCLKDIV)
-X(CMT_PHASER_OUT_C_OCLK1X_90)
-X(CMT_PHASER_OUT_C_OCLK)
-X(CMT_R_PHASER_OUT_D_RDENABLE_TOFIFO)
-X(CMT_R_PHASER_OUT_D_RDCLK_TOFIFO)
-X(CMT_R_PHASER_OUT_C_RDENABLE_FIFO)
-X(CMT_R_PHASER_OUT_C_RDCLK_FIFO)
-X(CMT_R_PHASER_IN_D_WRCLK_TOFIFO)
-X(CMT_R_PHASER_IN_C_WRCLK_FIFO)
-X(CMT_PHY_CONTROL_OBURSTPENDING3)
-X(CMT_PHY_CONTROL_OBURSTPENDING2)
-X(PLL_CLK_FREQBB_REBUFOUT3)
-X(PLL_CLK_FREQBB_REBUFOUT2)
-X(PLL_CLK_FREQBB_REBUFOUT1)
-X(PLL_CLK_FREQBB_REBUFOUT0)
-X(CMT_FREQ_BB_PREF_IN0)
-X(CMT_PHASER_IN_C_ICLKDIV)
-X(CMT_PHASER_C_OCLK_TOIOI)
-X(CMT_PHASER_C_OCLKDIV_TOIOI)
-X(CMT_PHASER_C_OCLK90_TOIOI)
-X(CMT_PHASER_C_ICLK_TOIOI)
-X(CMT_PHASER_C_ICLKDIV_TOIOI)
-X(CMT_PHASERTOP_PHYCTLMSTREMPTY)
-X(CMT_PHASERTOP_PHYCTLEMPTY)
-X(CMT_PHASERD_DTSBUS1)
-X(CMT_PHASERD_DTSBUS0)
-X(CMT_PHASER_IN_C_WRENABLE_FIFO)
-X(CMT_PHASER_IN_C_RCLK2)
-X(CMT_PHASER_IN_C_ICLK)
-X(CMT_PHASER_IN_D_ICLK)
-X(CMT_PHASER_IN_D_ICLKDIV)
-X(CMT_FREQ_BB_PREF_IN1)
-X(CMT_FREQ_BB_PREF_IN2)
-X(CMT_FREQ_BB_PREF_IN3)
-X(CMT_L_TOP_UPPER_B_CLKINT_2)
-X(CMT_L_TOP_UPPER_B_CLKINT_3)
-X(CMT_PHASERD_CTSBUS0)
-X(CMT_PHASERD_CTSBUS1)
-X(CMT_PHASERD_DQSBUS0)
-X(CMT_PHASERD_DQSBUS1)
-X(CMT_PHASER_IN_D_WRENABLE_FIFO)
-X(CMT_PHASER_IN_D_RCLK3)
-X(CMT_PHASER_IN_DB_ICLK)
-X(CMT_PHASER_IN_CA_TESTOUT0)
-X(CMT_PHASER_IN_CA_TESTOUT1)
-X(CMT_PHASER_IN_DB_ICLKDIV)
-X(CMT_PHASER_IN_DB_ISERDESRST)
-X(CMT_PHASER_REF_LOCKED)
-X(CMT_PHASER_REF_TESTOUT2)
-X(CMT_PHASER_IN_CA_TESTOUT2)
-X(CMT_PHASER_IN_DB_PHASELOCKED)
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-X(CMT_PHASER_IN_CA_STG1REGR2)
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-X(CMT_LR_LOWER_T_CLK_PERF3)
-X(CMT_PHASER_BOT_SYNC_BB)
-X(CMT_PHASER_B_TOMMCM_OCLK1X_90)
-X(CMT_LR_LOWER_T_CLK_IN1_HCLK)
-X(CMT_LR_LOWER_T_CLK_IN2_HCLK)
-X(CMT_LR_LOWER_T_CLK_IN3_HCLK)
-X(CMT_LR_LOWER_T_CLK_MMCM0)
-X(CMT_LR_LOWER_T_CLK_MMCM1)
-X(CMT_LR_LOWER_T_CLK_MMCM2)
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-X(CMT_LR_LOWER_T_CLK_MMCM7)
-X(CMT_LR_LOWER_T_CLK_MMCM8)
-X(CMT_LR_LOWER_T_CLK_MMCM9)
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-X(CMT_R_TOP_LOWER_B_CLKINT_0)
-X(CMT_R_TOP_LOWER_B_CLKINT_1)
-X(BUFMRCE_BUFMRCE)
-X(BUFMRCE_CEINV)
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-X(HCLK_CMT_MUX_CLK_9)
-X(HCLK_CMT_MUX_CLK_8)
-X(HCLK_CMT_MUX_CLK_7)
-X(HCLK_CMT_MUX_CLK_6)
-X(HCLK_CMT_MUX_CLK_5)
-X(HCLK_CMT_MUX_CLK_4)
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-X(HCLK_CMT_MUX_CLK_2)
-X(HCLK_CMT_MUX_CLK_1)
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-X(HCLK_CMT_MUX_PLLE2_CLKIN2)
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-X(HCLK_CMT_MUX_PLLE2_CLKFBIN)
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-X(HCLK_CMT_MUX_MMCM_CLKFBIN)
-X(HCLK_CMT_MUX_CLK_LEAF_UP1)
-X(HCLK_CMT_MUX_CLK_LEAF_UP0)
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-X(HCLK_CMT_MUX_PHSR_PERFCLK0)
-X(HCLK_CMT_MUX_PHSR_PERFCLK1)
-X(HCLK_CMT_MUX_PHSR_PERFCLK2)
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-X(HCLK_CMT_MUX_OUT_FREQ_REF2)
-X(HCLK_CMT_MUX_OUT_FREQ_REF3)
-X(HCLK_CMT_MUX_OUT_FREQ_REF1)
-X(HCLK_CMT_MUX_OUT_FREQ_REF0)
-X(HCLK_CMT_PREF_BOUNCE0)
-X(HCLK_CMT_PREF_BOUNCE1)
-X(HCLK_CMT_PREF_BOUNCE2)
-X(HCLK_CMT_PREF_BOUNCE3)
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-X(HCLK_CMT_BUFMR_PHASEREF0)
-X(HCLK_CMT_FREQ_REF_NS2)
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-X(HCLK_CMT_FREQ_REF_NS0)
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-X(HCLK_CMT_BUFMRCE_O1)
-X(HCLK_CMT_BUFMRCE_O0)
-X(HCLK_CMT_BUFMR_INP1)
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-X(HCLK_CMT_BUFMRCE_CEINP1)
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-X(HCLK_CMT_CK_BUFHCLK0)
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-X(HCLK_DSP_R)
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-X(BRKH_DSP_L)
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-X(ILOGICE2)
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