iCE40/yosys - [no description]

	Commit message (Collapse)	Author	Age	Files	Lines
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\| \| * \| \| \| \| \|	abc9 needs a clean afterwards	Eddie Hung	2019-12-16	1	-2/+4
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\| \| * \| \| \| \| \|	Merge remote-tracking branch 'origin/master' into xaig_dff	Eddie Hung	2019-12-12	3	-23/+136
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\| \| * \| \| \| \| \|	Merge remote-tracking branch 'origin/master' into xaig_dff	Eddie Hung	2019-12-06	6	-8/+412
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\| \| * \| \| \| \| \| \|	abc9_map.v to transform INIT=1 to INIT=0	Eddie Hung	2019-12-04	1	-0/+91
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\| \| * \| \| \| \| \| \|	Merge remote-tracking branch 'origin/eddie/submod_po' into xaig_dff	Eddie Hung	2019-11-27	1	-0/+31
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\| \| \| * \| \| \| \| \| \|	Add multiple driver testcase	Eddie Hung	2019-11-27	1	-0/+31
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\| \| * \| \| \| \| \| \| \|	Merge remote-tracking branch 'origin/master' into xaig_dff	Eddie Hung	2019-11-27	2	-0/+82
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\| \| * \ \ \ \ \ \ \ \	Merge remote-tracking branch 'origin/eddie/write_xaiger_improve' into xaig_dff	Eddie Hung	2019-11-27	1	-9/+0
\| \| \|\ \ \ \ \ \ \ \ \
\| \| * \ \ \ \ \ \ \ \ \	Merge remote-tracking branch 'origin/eddie/submod_po' into xaig_dff	Eddie Hung	2019-11-27	1	-2/+23
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\| \| \| * \| \| \| \| \| \| \| \|	Revert "submod to bitty rather bussy, for bussy wires used as input and output"	Eddie Hung	2019-11-27	1	-2/+5
\| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	This reverts commit cba3073026711e7683c46ba091c56a5c5a041a45.
\| \| \| * \| \| \| \| \| \| \| \|	Fix wire width	Eddie Hung	2019-11-26	1	-2/+2
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\| \| \| * \| \| \| \| \| \| \| \|	Add testcase where \init is copied	Eddie Hung	2019-11-25	1	-0/+18
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\| \| * \| \| \| \| \| \| \| \| \|	Merge remote-tracking branch 'origin/master' into xaig_dff	Eddie Hung	2019-11-25	5	-13/+24
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\| \| * \ \ \ \ \ \ \ \ \ \	Merge branch 'xaig_dff' of github.com:YosysHQ/yosys into xaig_dff	Eddie Hung	2019-11-23	3	-11/+11
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\| \| \| * \| \| \| \| \| \| \| \| \| \|	Another sloppy mistake!	Eddie Hung	2019-11-21	1	-1/+1
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\| \| \| * \| \| \| \| \| \| \| \| \| \|	Merge remote-tracking branch 'origin/xaig_dff' into eddie/xaig_dff_adff	Eddie Hung	2019-11-21	3	-4/+9
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\| \| \| * \| \| \| \| \| \| \| \| \| \| \|	async2sync -> clk2fflogic	Eddie Hung	2019-11-21	1	-1/+1
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\| \| * \| \| \| \| \| \| \| \| \| \| \| \|	Merge remote-tracking branch 'origin/eddie/submod_po' into xaig_dff	Eddie Hung	2019-11-22	1	-3/+0
\| \| \|\ \ \ \ \ \ \ \ \ \ \ \ \ \| \| \| \| \|_\|_\|/ / / / / / / / / \| \| \| \|/\| \| \| \| \| \| \| \| \| \| \|
\| \| \| * \| \| \| \| \| \| \| \| \| \| \|	Remove redundant flatten	Eddie Hung	2019-11-22	1	-2/+0
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\| \| \| * \| \| \| \| \| \| \| \| \| \| \|	Stray dump	Eddie Hung	2019-11-22	1	-1/+0
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\| \| * \| \| \| \| \| \| \| \| \| \| \| \|	Merge remote-tracking branch 'origin/eddie/submod_po' into xaig_dff	Eddie Hung	2019-11-22	1	-0/+28
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\| \| \| * \| \| \| \| \| \| \| \| \| \| \|	Add another test with constant driver	Eddie Hung	2019-11-22	1	-0/+28
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\| \| * \| \| \| \| \| \| \| \| \| \| \| \|	Add testcase for signal used as part input part output	Eddie Hung	2019-11-22	1	-0/+5
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\| \| * \| \| \| \| \| \| \| \| \| \| \| \|	Merge remote-tracking branch 'origin/eddie/submod_po' into xaig_dff	Eddie Hung	2019-11-22	1	-0/+25
\| \| \|\\| \| \| \| \| \| \| \| \| \| \| \|
\| \| \| * \| \| \| \| \| \| \| \| \| \| \|	Cleanup spacing	Eddie Hung	2019-11-22	1	-2/+1
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\| \| \| * \| \| \| \| \| \| \| \| \| \| \|	Add testcase	Eddie Hung	2019-11-22	1	-0/+26
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\| \| * \| \| \| \| \| \| \| \| \| \| \| \|	Merge branch 'eddie/clkpart' into xaig_dff	Eddie Hung	2019-11-22	2	-1/+63
\| \| \|\\| \| \| \| \| \| \| \| \| \| \| \|
\| \| * \| \| \| \| \| \| \| \| \| \| \| \|	Missing endmodule	Eddie Hung	2019-11-22	1	-0/+1
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\| \| * \| \| \| \| \| \| \| \| \| \| \| \|	Merge branch 'eddie/xaig_dff_adff' into xaig_dff	Eddie Hung	2019-11-21	3	-3/+37
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\| \| \| * \| \| \| \| \| \| \| \| \| \| \|	Add a equiv test too	Eddie Hung	2019-11-19	2	-0/+23
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\| \| \| * \| \| \| \| \| \| \| \| \| \| \|	Add two tests	Eddie Hung	2019-11-19	1	-0/+12
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\| \| * \| \| \| \| \| \| \| \| \| \| \| \|	Add test	Eddie Hung	2019-11-21	1	-1/+6
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\| \| * \| \| \| \| \| \| \| \| \| \| \|	Add multi clock test	Eddie Hung	2019-11-20	1	-0/+5
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\| * \| \| \| \| \| \| \| \| \| \| /	Add testcase from #1459	Eddie Hung	2020-01-06	1	-0/+25
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\| * \| \| \| \| \| \| \| \| \| \|	Merge pull request #1606 from YosysHQ/eddie/improve_tests	Eddie Hung	2020-01-01	9	-11/+12
\| \|\ \ \ \ \ \ \ \ \ \ \ \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Fix a few issues in tests/arch/*
\| \| * \| \| \| \| \| \| \| \| \| \|	Revert insertion of 'reg', leave note behind	Eddie Hung	2020-01-01	1	-1/+2
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\| \| * \| \| \| \| \| \| \| \| \| \|	Do not do call equiv_opt when no sim model exists	Eddie Hung	2019-12-31	2	-4/+4
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\| \| * \| \| \| \| \| \| \| \| \| \|	Fix warnings	Eddie Hung	2019-12-31	2	-2/+2
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\| \| * \| \| \| \| \| \| \| \| \| \|	Call equiv_opt with -multiclock and -assert	Eddie Hung	2019-12-31	5	-5/+5
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\| * / \| \| \| \| \| \| \| \| \|	Added a test case	Miodrag Milanovic	2020-01-01	1	-0/+19
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\| * \| \| \| \| \| \| \| \| \|	Merge pull request #1589 from YosysHQ/iopad_default	Miodrag Milanović	2019-12-30	19	-60/+61
\| \|\ \ \ \ \ \ \ \ \ \ \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Make iopad option default for all xilinx flows
\| \| * \| \| \| \| \| \| \| \| \|	Fix new tests	Miodrag Milanovic	2019-12-28	3	-6/+6
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\| \| * \| \| \| \| \| \| \| \| \|	Merge remote-tracking branch 'origin/master' into iopad_default	Miodrag Milanovic	2019-12-28	5	-0/+141
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\| \| * \| \| \| \| \| \| \| \| \| \|	Make test without iopads	Miodrag Milanovic	2019-12-28	17	-51/+51
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\| \| * \| \| \| \| \| \| \| \| \| \|	Revert "Fix xilinx tests, when iopads are default"	Miodrag Milanovic	2019-12-28	16	-40/+40
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\| \| * \| \| \| \| \| \| \| \| \| \|	Addressed review comments	Miodrag Milanovic	2019-12-21	1	-1/+0
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\| \| * \| \| \| \| \| \| \| \| \| \|	Fix xilinx tests, when iopads are default	Miodrag Milanovic	2019-12-21	17	-42/+44
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\| * \| \| \| \| \| \| \| \| \| \|	Merge pull request #1599 from YosysHQ/eddie/retry_1588	Eddie Hung	2019-12-30	3	-0/+48
\| \|\ \ \ \ \ \ \ \ \ \ \ \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Retry #1588 -- "write_xaiger: only instantiate each whitebox cell type once"
\| \| * \| \| \| \| \| \| \| \| \| \|	Add #1598 testcase	Eddie Hung	2019-12-27	3	-0/+48
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\| * / \| \| \| \| \| \| \| \| \|	Update resource count	Eddie Hung	2019-12-28	1	-3/+3
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